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H9TQ64A8GTMCUR CI-MCP规范手册

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发表于 2020-12-4 10:51:39 | 显示全部楼层 |阅读模式 来自 广东省深圳市
SK-hynix e-NAND由nandflash和MMC控制器组成。e-NAND具有内置的智能控制器,用于管理接口协议、损耗均衡、坏块管理、垃圾收集和ECC。e-NAND保护数据内容不受主机突然断电故障的影响。e-NAND与JEDEC标准eMMC5.0规范兼容。


特征
CI-MCP
工作温度:(-25)摄氏度~85摄氏度
包装:221球FBGA;11.5x13.0mm2,1.0t,0.5mm间距;无铅无卤

e-NAND
1.兼容eMMC5.0
2.总线模式
-数据总线宽度:1位(默认)、4位、8位
-数据传输速率:高达400MB/s(HS400
-MMC I/F时钟频率:0~200MHz
-MMC I/F启动频率:0~52MHz
3.工作电压范围:Vcc(NAND):2.7-3.6伏;Vccq(控制器):1.7-1.95V/2.7-3.6V
4.温度:运行(-25℃~+85℃);非操作储存(-40℃~+85℃)
5.其他:本产品符合RoHS指令

LPDDR3
1.DM屏蔽在数据选通的上升和下降沿写入数据
2.可编程RL(读取延迟)和WL(写入延迟)
3.可编程突发长度:8
4.支持自动刷新和自刷新
5.支持所有银行自动刷新和每个银行自动刷新
6.自动TCSR(温度补偿自刷新)
7.按组掩码和段掩码的PASR(部分阵列自刷新)
8.DS(驱动强度)
9.DPD(深度断电)
10.ZQ(校准)
11.ODT(模具端接)

e-NAND特性
密度:8GB
顺序读取(MB/s):160
顺序写入(MB/s): 20
试验条件:选项:高速缓存/压缩/HS400;测试工具:Uboot(无O/S);块大小:1MB,测试区域:1GB


e-NAND结构图

e-NAND结构图

e-NAND结构图


LPDDR3-SDRAM是一种高速同步DRAM设备,内部配置为8块内存。
LPDDR3设备在命令/地址(CA)总线上使用双数据速率架构,以减少系统中的输入管脚数。10位CA总线包含命令、地址和银行信息。每个命令使用一个时钟周期,在此期间命令信息在时钟。这些设备还使用双数据速率架构在DQ引脚上实现高速操作。双数据速率架构本质上是一个8n预取架构,其接口设计为在I/O引脚的每个时钟周期内传输两个数据位。LPDDR3 SDRAM的单次读写访问有效地包括在内部DRAM核心上的单个8n位宽、一个时钟周期的数据传输和在I/O处的八个相应的n位宽、一个半时钟周期的数据传输别针。读对lpddr3sdram的写访问是面向突发的;从选定的位置开始访问,然后按编程顺序继续访问编程数量的位置。访问首先注册一个Activate命令,然后注册一个读或写命令。与Activate命令同步注册的地址和BA位用于选择要访问的行和银行。与读或写命令同步注册的地址位用于选择突发的银行和起始列位置访问。优先要正常工作,必须初始化LPDDR3 SDRAM。以下部分提供了设备初始化、寄存器定义、命令描述和设备操作的详细信息。

平衡图

平衡图



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H9TQ64A8GTMCUR CI-MCP规范手册
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  • 一牛网商城 一牛网直播
发表于 2020-12-4 11:20:41 | 显示全部楼层 来自 上海市
挺好的,看看
发表于 2022-5-13 11:47:04 | 显示全部楼层 来自 广东省深圳市
命令队列 为了方便eMMC中的命令队列,设备管理一个内部任务队列,主机可以在数据传输任务期间对其进行排队。每个任务都由主机发出,最初作为挂起队列。该设备用于准备待执行任务。当任务准备执行时,其状态变为“准备执行”。主机跟踪所有排队任务的状态,并可以命令执行任何任务,标记为“准备执行”,通过发送指示其任务ID的命令。设备在收到执行命令(CMD46/CMD47)后执行数据传输事务
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