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[单片机资料] 华大HC32F146/HC32M140系列MCU用户手册

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发表于 2021-11-2 17:17:54 | 显示全部楼层 |阅读模式 来自 广东省深圳市
1. 系统
1.1 总线架构
本节介绍本系列的总线架构。
本系列的总线使用 AHB 总线矩阵电路来实现多层总线。以下介绍主控和从动架构。
●主控架构
– Cortex-M0+ CPU(AHB-Lite 系统总线)
●从动架构
– 内部闪存
– 内部 SRAM(MTB 共享) – AHB-AHB 总线架桥
– AHB-APB 总线架桥(APB0, 1)

特征
●RAM 架构
用户 SRAM 区域可以和 MTB SRAM 区域共享。两块区域的划分由用户配置决定。
●APB扩展总线
APB1外围总线是扩展 APB 总线(不包含 APB0),而下列功能最初是基于 AMBA3.0 单独追加的(不包括 APB0)。
– 支持半字(16 位)访问和字节(8 位)访问。
– 可使用半字和字节访问所支持的寄存器。
– 关于所支持的寄存器,可参考"寄存器映射"。
– 增加了读-修改-写(RMW)信号。
– 位带操作时,通常要产生 HMASTLOCK 信号。
– 增加 RMW 信号是为了防止在位带操作时进行读-修改-写处理而错误清除无关标志。对应的标志在进行读-修改-写处理的读取操作时读"1",忽略写"1"操作。这样可以避免标志在"读-修改-写"顺序的读取操作后被马上置位,却在下一次写操作时被错误地清零。
– 对应的标志和寄存器记述如下:"读-修改-写"时,与位值无关,读"1。
●优先级
– 总线权优先级由轮询调度机制决定。
●端模式
– 这个系列采用小端模式。
注意事项
●针对禁止RMW操作的寄存器,不可进行位带操作。
●通过软件而不是位带操作进行读-修改-写时,不输出RMW信号。因此,此时即使寄存器支持RMW过程,读取时仍然可以读标志值,注意在写入时,不要错误地清除无关标志。
●关于位带操作,详情参见"Cortex-M3技术参考手册"。此位带操作与Cortex-M3兼容。

1.1.1 总线架构图
1.jpg

1.1.2 存储器架构
本节介绍本系列的存储器架构。
本系列拥有4GB的地址空间。
存储器架构定义最大1MB的FLASH区、最大512KB的片上SRAM区。

1.2 Cortex-M0+架构
本节介绍本系列的内核架构。
注意:功能模块的架构根据产品不同而不同。详情请参考“1.2.1 选型配置”
• Cortex-M0+ 内核
本系列搭载高性能 32 位处理器内核(ARM Cortex-M0+ 内核)。本外围手册没有详细描述Cortex-M0+ 内核,详情参见"Cortex-M0+ 技术参考手册"。
• Cortex-M0+ 内核版本
关于 Cortex-M0+ 内核版本,参照"数据手册"。
• NVIC(嵌套向量中断控制器)
– 本系列可使用 1 个 NMI(不可屏蔽中断)和 32 个外围中断(IRQ0 ~ IRQ31)*1。而且,中断优先级寄存器(从 0xE000E400 开始)由 2 位构成,并可以设定 4 级中断优先级。
– 关于外围中断,详情参见"中断"一章;关于 NMI 操作,参见"外部中断及 NMI 控制部分"一章。
– NMI 引脚可以兼用作其他功能。复位后的初始值设定为通用口,NMI 输入被屏蔽了,可通过端口设定来使能 NMI 功能。详情参见"I/O 口"一章和"外部中断及 NMI 控制部分"一章。
*1:"Cortex-M0+ 技术参考手册"定义的异常类型: 将 IRQ 视为外部中断。本手册为了区 分 IRQ 和来自外部终端的中断,也定义了异常类型: 将 IRQ 定义为外围中断。
当高优先级的中断在处理过程中,外设产生的中断会在 NVIC 内部等待。当取消 NVIC内部等待的中断请求时,清除外设中断请求,通过清除 NVIC 内部中断等待寄存器(从0xE000E280 开始)来清除 NVIC 内部的等待中断请求。

2. 时钟
2.1 概述
本节为时钟产生单元的概述。
时钟产生单元为 MCU 提供不同类型的时钟。
源时钟是 MCU 内部 RC 时钟和外部时钟的总称。源时钟有以下五种类型:
– 外部高速时钟(HSXT)
– 外部低速时钟(LSXT)
– 内部高速 RC 时钟(HICR)
– 内部低速 RC 时钟(LICR)
– PLL 时钟(PLL)
主时钟是 MCU 总线的工作时钟源,可以是四种源时钟的一种。
基础时钟是主时钟的分频时钟。基础时钟再分频可以得到各个总线时钟。
在本章,基础时钟和总线时钟统称为内部总线时钟,内部总线时钟包括以下三种类型:
– 基础时钟(HCLK)
– APB0 总线时钟(PCLK0)
– APB1 总线时钟(PCLK1)
以下是时钟产生单元的基本功能:
– 可以设置外部高速时钟的稳定时间,时钟稳定后可以产生中断
– 可以设置外部低速时钟的稳定时间,时钟稳定后可以产生中断
– 外部高速时钟和外部低速时钟发生异常可以复位或产生中断
– 可以选择主时钟来源
– 可以设置内部总线时钟的分频比例
– 可以停止提供 APB1 总线时钟
– 可以设置软件监视定时器计数时钟的分频比例
– 可以停止提供硬件监视定时器和软件监视定时器的计数时钟
– 调试模式下,硬件监视定时器和软件监视定时器可以停止工作

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