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[arm开发资料] Arm Cortex-M0+ 处理器规格书datasheet

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发表于 2023-1-15 11:21:02 | 显示全部楼层 |阅读模式 来自 广东省深圳市
Cortex-M0+处理器建立在非常成功的Cortex-M0处理器的基础上,保留了完整的指令集和工具兼容性,同时进一步降低能耗并提高性能。

Cortex-M0+的硅片面积特别小,功耗低,代码占用空间最小,使开发人员能够以8位的价格实现32位的性能,绕过了向16位器件的过渡。Cortex-M0+处理器有多种选择,可提供灵活的开发。
Cortex-M0+处理器是一个可配置的、多级的32位RISC处理器。 它有一个AMBA AHB-Lite接口,包括一个嵌套的矢量中断控制器(NVIC)组件。它还具有可选的硬件调试、单周期I/O接口和内存保护功能。该处理器可以执行Thumb代码,并与其他Cortex-M配置文件处理器兼容。

图1:Cortex-M0+处理器的方框图

图1:Cortex-M0+处理器的方框图

图1:Cortex-M0+处理器的方框图

特征
FeatureDescription
ArchitectureArmv6-M
Pipeline2-stage
Bus InterfaceAMBA AHB-Lite (Von Neumann bus architecture)
ISA SupportThumb/Thumb-2 subset
Memory ProtectionOptional Memory Protection Unit (MPU) with up to eight regions
InterruptsNon-Maskable Interrupt (NMI) and up to 32 physical interrupts
Wake-up Interrupt Controller (WIC)Optional for waking up the processor from state retention power gating or when all clocks are stopped
Sleep ModesIntegrated Wait For Interrupt (WFI) and Wait For Event (WFE) instructions and Sleep On Exit capability
Sleep and Deep Sleep signals
Optional retention mode with Arm Power Management Kit
Enhanced InstructionsHardware single-cycle (32*32) multiply
DebugOptional JTAG and Serial Wire Debug ports Up to four breakpoints and two watchpoints
TraceOptional Micro Trace Buffer (MTB)



处理器特性
  • 采用 Thumb-2 技术的 Armv6-M Thumb® 指令集
  • 可选的 Armv6-M 兼容 24 位 SysTick 定时器
  • 一个 32 位硬件乘法器。 这可以是标准的单周期乘法器,或具有较低面积和性能实现的 32 周期乘法器
  • 支持小端或字节不变大端数据访问
  • 具有确定性、固定延迟、中断处理的能力
  • 加载/存储多个和多周期乘法指令,可以
  • 被放弃并重新启动以促进快速中断处理
  • 可选地,非特权/特权支持以提高系统完整性
  • Armv6-M C 应用程序二进制接口 (C-ABI) 兼容异常模型,支持使用纯 C 函数作为中断处理程序
  • 使用 WFI 和 WFE 指令进入低功耗睡眠模式,或从中断退出时睡眠功能返回



框图

框图

框图

图2:Cortex-M0+处理器组件


Cortex-M0+ 组件
NVIC 功能
多达 32 个外部中断输入,每个都有四个优先级
专用 NMI 输入
支持电平敏感和脉冲敏感中断线
提供超低功耗睡眠模式支持的可选 WIC
向量表的可选重定位

可选的调试支持
零到四个硬件断点
零到两个观察点
用于非侵入式代码分析的程序计数器采样寄存器 (PCSR),如果至少实现了一个硬件数据观察点
单步和矢量捕获功能
使用 BKPT 指令支持无限的软件断点
通过紧凑的总线矩阵以非侵入方式访问核心外设和零等待状态系统从属设备。 即使处理器正在运行,调试器也可以访问这些设备,包括内存
处理器停止时对核心寄存器的完全访问
通过支持串行线或 JTAG 调试连接的调试访问端口 (DAP),可选的低门数 CoreSight 兼容调试访问

总线接口
单个 32 位 AMBA-3 AHB-Lite 系统接口,提供简单的
集成到所有系统外围设备和内存
可选的单个 32 位单周期 I/O 端口
支持 DAP 的可选单 32 位从端口
可选主控板:
- 八个用户可配置的内存区域
- 每个区域禁用八个子区域
- 从不执行 (XN) 支持
- 默认内存映射支持

可选内存保护单元 (MPU):
八个用户可配置的内存区域
每个区域禁用八个子区域
从不执行 (XN) 支持
默认内存映射支持


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